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纳米CMOS工艺锁相环频率合成器电源噪声模型研究
  • 项目名称：纳米CMOS工艺锁相环频率合成器电源噪声模型研究
  • 项目类别：青年科学基金项目
  • 批准号：61106024
  • 申请代码：F040202
  • 项目来源：国家自然科学基金
  • 研究期限：2012-01-01-2014-12-31
  • 项目负责人：唐路
  • 依托单位：东南大学
  • 批准年度：2011
中文摘要：

锁相环频率合成器电源噪声模型的研究将为解决纳米CMOS工艺实现的用于较高频段通信系统射频集成电路中的噪声瓶颈问题提供有力的理论与技术支持，具有重要的学术意义与应用价值。本研究围绕纳米CMOS锁相环频率合成器的电源噪声模型理论及其测量与验证方法开展创新研究，结合射频集成电路芯片的测试技术建立新的工作在较高频段的频率合成器电源噪声模型的验证与优化方法，并探索其在射频前端芯片设计中的应用。目标是为提高射频集成电路电源噪声模型的测量与验证的准确度提供新途径。

中文主题词： 射频集成电路；锁相环；测试；模型；CMOS
英文摘要：

RFIC；PLL；measurement；model；CMOS

英文主题词： RFIC；PLL；measurement；model；CMOS
结论摘要：

本项目围绕纳米CMOS 锁相环频率合成器的电源噪声模型理论及其测量与验证方法开展创新性研究。本项目建立了快速的高阶锁相环频率合成器尤其是小数频率合成器的环路电源噪声行为级仿真模型的算法用于分析纳米CMOS锁相环频率合成器整体的电源噪声模型；本项目还设计了用于纳米CMOS锁相环频率合成器电源噪声测试的模块，并完善了锁相环电源噪声模型的测试协同技术。在此基础之上，本项目将上述研究成果用于指导相关的CMOS射频芯片的设计，改善了电路的性能。

成果综合统计
成果类型
数量
  • 期刊论文
  • 会议论文
  • 专利
  • 获奖
  • 著作
  • 36
  • 6
  • 0
  • 0
  • 1
期刊论文
A multi-band CMOS PLL-based frequency synthesizer for DRM/DRM+/DAB systems
DAB射频接收机中的高性能电荷泵设计
Lower-power, high-linearity class-AB current-mode programmable gain amplifier
Design of a novel mixer with high gain and linearity improvement for DRM/DAB applications
一种用于射频调谐器的低相位噪声低功耗晶体振荡器(英文)
A high-speed mixed-signal down-scaling circuit for DAB tuners
Low phase noise millimeter wave monolithic integrated phase locked-loop
5 Gb/s 2:1 fully-integrated full-rate multiplexer with on-chip clock generation circuit in 0.18-&
Design of improved CMOS phase-frequency detector and charge-pump for phase-locked loop
A Ka-band wide locking range frequency divider with high injection sensitivity
A 31–45.5 GHz injection-locked frequency divider in 90-nm CMOS technology
CMOS毫米波低功耗超宽带共栅低噪声放大器
D类音频功放芯片自恢复过流保护电路
基于低压高精度运放的带隙基准电压源设计
Analysis and modeling of on-chip transformers under two ground conditions
A new equivalent circuit model for on-chip spiral transformers in CMOS RFICs
Mismatch Analysis for Harmonic Rejection Mixer
Design of a high linearity and high gain accuracy analog baseband circuit for DAB receiver
新的高镜像抑制比DAB接收机射频前端架构的研究
具有采样保持功能的10Gbit／s突发模式激光驱动器的设计与实现①
一种用于射频调谐器的低相位噪声低功耗晶体振荡器
Multisim在“通信电子线路”实验教学中的应用
A 31-45.5 GHz injection-locked frequency divider in 90-nm CMOS technology
会议论文
<span style="line-height:31px;font-family:verdana;font-size:22px;background-color:#FFFFFF;&q
Design of 0.18-&mu;m CMOS low drop-out regulator for 2.4-GHz wireless transceiver
High speed and memory efficient VLSI architecture of 2D 5/3 DWT using interlaced scan algorithm for
Design Of Key Blocks In PLL For UWB System
Wideband noise cancelling LNA with tunable active inductor for DRM/DAB receiver
A wide tuning range ring VCO with low phase&nbsp;noise in 90-nm CMOS
著作
通信电子线路实验教程
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