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基于智能算法的MPRM电路极性优化研究
  • 项目名称：基于智能算法的MPRM电路极性优化研究
  • 项目类别：面上项目
  • 批准号：61076032
  • 申请代码：F040204
  • 项目来源：国家自然科学基金
  • 研究期限：2011-01-01-2013-12-31
  • 项目负责人：汪鹏君
  • 负责人职称：教授
  • 依托单位：宁波大学
  • 批准年度：2010
中文摘要：

Reed-Muller(RM)逻辑优化是集成电路综合设计的重要方面，当前RM逻辑优化主要基于固定极性RM（FPRM）电路展开，而与其对应的混合极性RM（MPRM）逻辑电路虽然优化性能更好，但求解难度也更大。鉴此，本项研究旨在通过完善MPRM逻辑优化理论、发展适合MPRM逻辑优化的智能算法、建立全面的极性评价方法，实现电路功耗、面积和速度的综合优化。主要研究内容包括MPRM极性优化问题的属性论证及数学模型建立；MPRM逻辑电路功耗估计及低功耗分解；包含无关项的MPRM逻辑电路极性转换；适合MPRM逻辑电路优化的智能算法构建；极性评价及MPRM逻辑电路的最佳极性搜索。通过基准电路测试，完善优化方案，并用SIS工具软件和FPGA或多项目流片等方法验证方案的有效性。研究成果将扩充大规模集成电路逻辑综合与优化CAD工具的完备性，推进集成电路自动化设计技术的发展。

中文主题词： MPRM电路；极性优化；智能算法；低功耗分解；极性评价
英文摘要：

MPRM circuit；Polarity optimization；Intelligence algorithm；Low power decomposition；Polarity evaluation method

英文主题词： MPRM circuit；Polarity optimization；Intelligence algorithm；Low power decomposition；Polarity evaluation method
结论摘要：

本项目以混合极性Reed-Muller逻辑(MPRM)优化为研究对象，通过完善MPRM逻辑优化理论、发展适合MPRM逻辑优化的智能算法、建立全面的极性评价方法，实现电路功耗、面积和速度的综合优化。研究内容包括MPRM电路的功耗和面积优化，MPRM逻辑电路的延时优化，包含无关项MPRM逻辑电路优化，集成电路的应用开发关键技术研究。项目研究期间完成完成学术论文51篇，其中期刊论文36篇，国际学术会议论文11篇，国内学术会议论文4篇，SCI收录4篇，EI收录32篇；申请专利9项，其中已授权7项。项目研究期间，1名中级职称晋升为高级职称；培养博士研究生1名，硕士研究生9名。相关技术在集成电路设计中得到应用，部分成果获得浙江省科学技术奖二等奖1项、宁波市科技进步奖一等奖1项、宁波市自然科学优秀论文奖1项等。研究成果为扩充大规模集成电路逻辑综合与优化CAD工具的完备性，推进集成电路自动化设计技术的发展。

成果综合统计
成果类型
数量
  • 期刊论文
  • 会议论文
  • 专利
  • 获奖
  • 著作
  • 41
  • 15
  • 12
  • 6
  • 0
期刊论文
Design of a high information-density multiple valued 2-read 1-write register file
三值绝热多米诺文字运算电路开关级设计
基于新型极性转换技术的XNOR/OR电路面积优化
改进型高吞吐率QC-LDPC码解码器设计
2-4混值/8值绝热加减法计数器开关级设计
四值绝热动态D触发器开关级设计
基于OKFDDs的Reed-Muller逻辑混合极性转换算法
基于电路三要素理论的三值绝热加法器设计
Architecture and Physical Implementation of Reconfigurable Multi-Port Physical Unclonable Functions
Model and physical implementation of multi-port PUF in 65 nm CMOS
采用FDDs实现FPRM电路延时和面积优化
防御差分功耗分析攻击技术研究
基于DTPSO算法的混合极性XNOR/OR电路功耗优化
基于遗传算法的三值FPRM电路面积优化
基于PSGA算法的ISFPRM电路面积与功耗优化
Delay-area trade-off for MPRM circuits based on hybrid discrete particle swarm optimization
防御零值功耗攻击的AES SubByte模块设计及其VLSI实现
基于PSO算法的FPRM电路延时和面积优化
三值绝热多米诺加法器开关级设计
基于MSMV的抗差分能量攻击电路设计及其应用
三值绝热JKL触发器的设计
Design of Two-phase SABL flip-flop for resistant DPA attacks
Design of ternary clocked adiabatic static random access memory
Low power mapping for AND/XOR circuits and its application in searching the best mixed-polarity
Design of Ternary Adiabatic Multiplier on Switch-level
基于多值开关—信号理论的三值低功耗动态异或/同或电路设计
Design of ternary low-power Domino JKL flip - Flop and its application
包含无关项逻辑函数的固定极性转换
基于种群协同进化算法的固定极性动态逻辑电路功耗优化
混合极性列表技术及其在MPRM电路面积优化中的应用
Discrete ternary particle swarm optimization for area optimization of MPRM circuits
固定极性Reed-Muller电路最佳延时极性搜索
三值绝热计数器的开关级设计
三值绝热多米诺可逆计数器设计
Design of ternary low-power Domino JKL flip-flop and its application
基于模糊遗传算法的XNOR/OR展开式最小化研究
三值FPRM电路极性间转换算法及其在面积优化中的应用
会议论文
2-4混值/八值绝热加减计数器开关级设计
基于免疫遗传算法的动态逻辑AND/XOR电路功耗优化
QC-LDPC码的低复杂度解码算法研究
Design of 2-3 mixed-valued/six-valued adiabatic asynchronous up-down counter
Greedy algorithm based XNOR/OR gates decomposition
Design of resistant DPA three-valued counter based on SABL
Power optimization of incompletely specified fixed polarity Reed-Muller circuits
Design of ternary clocked adiabatic synchronous reversible counter
Design of ternary adiabatic Domino multiplier
Improvement of adiabatic domino circuits and its application in multi-valued circuits
A novel differential fault analysis on AES-128
Polarity optimization of XNOR/OR circuit area and power based on weighted sum method
Low complexity decoding algorithm of QC-LDPC code
MPRM expressions minimization based on simulated annealing genetic algorithm
基于种群协同进化算法的动态逻辑XNOR/OR电路功耗优化
专利
一种与/异或电路的最佳混合极性搜索方法
一种多码率准循环低密度奇偶校验码解码器
一种单功率时钟钟控传输门三值绝热电路及T运算电路
一种用于数字电路设计的固定极性转换方法
一种基于贪婪算法的同或/或电路的分解方法
一种基于混值的八值绝热加减法计数器
一种三值绝热低功耗乘法器单元及乘法器
一种混合极性同或/或电路的功耗优化方法
一种三值绝热D触发器及四位三值绝热同步可逆计数器
一种四值绝热动态D触发器
一种固定极性里德穆勒电路延时和面积的优化方法
一种三值绝热低功耗加法器单元及加法器
获奖
基于新型极性转换技术的XNOR/OR电路面积优化
集成电路功耗和面积优化设计关键技术
节能型数字集成电路设计关键技术
基于新型极性转换技术的XNOR/OR电路面积优化
集成电路功耗和面积优化设计关键技术
节能型数字集成电路设计关键技术
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