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基于MCTGAL的高信息密度集成电路低功耗关键技术研究
  • 项目名称：基于MCTGAL的高信息密度集成电路低功耗关键技术研究
  • 项目类别：面上项目
  • 批准号：60776022
  • 申请代码：F040201
  • 项目来源：国家自然科学基金
  • 研究期限：2008-01-01-2010-12-31
  • 项目负责人：汪鹏君
  • 负责人职称：教授
  • 依托单位：宁波大学
  • 批准年度：2007
中文摘要：

本项目以低功耗多值逻辑电路为研究对象，研究低功耗高信息密度CMOS集成电路的实现途径。项目研究内容包括（1）通过对高信息密度集成电路功耗机理的研究，结合信号几率传递算法，建立功耗计算模型；（2）在研究多值电路三要素理论基础上提出绝热电路通用理论，为绝热电路设计提供理论依据；（3）利用绝热电路三要素理论，设计一种新颖多值全绝热电路-多值钟控传输绝热逻辑（MCTGAL）单元电路，并设计相应的多值低功耗数字器件；（4）研究适用于MCTGAL电路要求的钟控信号；（5）采用现有标准工艺，通过计算机仿真和多项目流片、测试，证明所设计的电路具有正确的逻辑功能及理想的低功耗、高信息密度特性。项目完成后，可以获得具有能量恢复功能的全绝热高信息密度CMOS集成电路的低功耗设计能力，在低功耗CMOS数字系统中具有广泛的应用价值，可以为高信息密度集成电路的实用化提供新的电路结构、新的设计方案。

中文主题词： 低功耗；高信息密度；CMOS集成电路；MCTGAL；钟控信号
成果综合统计
成果类型
数量
  • 期刊论文
  • 会议论文
  • 专利
  • 获奖
  • 著作
  • 44
  • 20
  • 0
  • 0
  • 0
期刊论文
2-4混值/8值绝热加减法计数器开关级设计
基于OKFDDs的Reed-Muller逻辑混合极性转换算法
基于电路三要素理论的三值绝热加法器设计
基于遗传算法的DFRM极性转换
采用vMOS管的多值计数器设计
基于多值开关-信号理论的三值低功耗动态异或/同或电路设计
基于钟控神经MOS管的多值双边沿D触发器设计
基于电路三要素理论的四值同步可逆计数器设计
三值绝热门控串行数值比较器设计
基于神经MOS管的新型反相器设计
基于CTGAL电路的进制可变计数器设计
三值钟控传输门绝热逻辑电路研究
Power Optimization Algorithm Based on XNOR/OR Logic
绝热电路三要素理论及其应用
基于CTGAL电路的绝热4-2压缩器和乘法器设计
基于动态逻辑的MPRM电路低功耗优化设计
基于CTGAL电路的低功耗十进制复位计数器设计
Design of Four-valued Counter Based on NeuMOS
基于CTGAL电路的并行前缀加减法器设计
时钟低摆幅三值双边沿低功耗触发器的设计
基于整体退火遗传算法的低功耗最佳极性搜索
基于钟控传输门绝热逻辑电路的绝热FIFO设计
Design of a DTCTGAL circuit and its application
Design of adiabatic two’s complement multiplier-accumulator based on CTGAL
基于XNOR/OR逻辑的低功耗最佳极性搜索
具有预计算功能的新型绝热数值比较器设计
量子遗传算法在多输出Reed-Muller逻辑电路最佳极性搜索中的应用
Area Optimization of Fixed-Polarity Reed-Muller Circuits Based on Niche Genetic Algorithm
Low Power Polarity Conversion Based on the Whole Annealing Genetic Algorithm
基于量子遗传算法的XOR/AND电路功耗和面积优化
扩展Toffoli门及其在多输出电路设计中的应用
基于免疫算法的生产调度现状与展望
Low power mapping for AND/XOR circuits and its application in searching the best mixed-polarity
混合极性列表技术及其在MPRM电路面积优化中的应用
三值绝热计数器的开关级设计
基于整体退火遗传算法的低功耗极性转换
量子遗传算法在多输出Reed—Muller逻辑电路最佳极性搜索中的应用
会议论文
基于开关信号理论的四值绝热动态D触发器设计
2-4混值/八值绝热加减计数器开关级设计
基于免疫遗传算法的动态逻辑AND/XOR电路功耗优化
Design of Low-Power Complementary Pass-Transistor and Ternary Adder Based on Multi-valued Switch-sig
Design of Ternary Adiabatic T-operation Circuit Based on the Theory of Three Essential Circuit Eleme
A Novel Quantum Genetic Algorithm for Area Optimization of FPRM Circuits
Design of Turbo Decoder Based on Min-Sum Decoding Algorithm of LDPC Code
三值钟控绝热同步可逆计数器设计
Low Complexity Decoding Algorithm of QC-LDPC Code
Low-power Synthesis for MPRM Circuit Based on Exhaustive Algorithm
Design of Ternary Clocked Adiabatic Shift Register
MPRM Expressions Minimization Based on Simulated Annealing Genetic Algorithm
Design of Novel QCTGAL Circuit
Design of A Novel Multi-Rate QC-LDPC Decoder
Switch-level Design of Ternary Adiabatic Counter Based on T-operation
Design of Four-valued Operation Circuits of Adder and Subtraction Based on Neuron MOS Transistor
Design of Low-Power Ternary Magnitude Comparator Based on Multi-valued Switch-signal Theory
Area Minimization of MPRM Circuits
Design of Multi-valued Double-edge-triggered JK Flip-flop Based on Neuron MOS Transistor
Least Operation Traversal Method Applied in Optimization of Logic Circuits
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